1️⃣ HBM의 확장, 그리고 ‘공급망 병목’의 그림자
AI 인프라의 핵심인 HBM(High Bandwidth Memory) 은
2025~2027년 동안 반도체 산업에서 가장 빠르게 성장하는 세그먼트입니다.
그러나 수요의 급등 속도는 공급 체계가 감당하기 어렵습니다.
TSV(Through-Silicon Via) 공정, CoWoS/HPC 패키징, Substrate(기판) 등
세부 밸류체인의 병목 현상이 HBM 공급의 결정적 제약으로 작용하고 있습니다.
2025년 기준 글로벌 HBM 공급 능력은 약 80만 장/월,
AI 서버 수요를 완전 충족하려면 최소 130만 장/월이 필요합니다.
즉, 시장은 **“수요 초과 60%”**의 불균형 상태로 진입했습니다.
2️⃣ TSV 공정: 병목의 중심에 선 기술
TSV는 HBM의 핵심 연결 기술로,
칩을 수직으로 적층해 데이터 처리 속도를 높이는 구조입니다.
문제는 TSV 가공 자체가 생산 단가의 35% 이상을 차지하며,
웨이퍼 처리량이 제한적이라는 점입니다.
| SK hynix | 자체 TSV 라인 | 48% | 생산 집중, 공정 효율 우수 |
| 삼성전자 | 평택 2라인 중심 | 36% | 3nm 연계 가능 |
| Micron | 파운드리 외주형 | 16% | TSMC 협력형 구조 |
TSV 병목은 단순한 장비 부족이 아니라,
수율 확보와 소재 정밀도의 문제로 이어지고 있습니다.
현재 TSV 가공 장비의 월 처리 한계는 6만~8만 장 수준으로,
AI용 HBM 수요를 충족하기에 부족한 실정입니다.
3️⃣ CoWoS / HPC 패키징: 장비 캐파의 한계
TSMC와 삼성전자는 모두 CoWoS(Chip-on-Wafer-on-Substrate) 패키징 공정의
생산능력을 2026년까지 2배 이상 확대할 계획입니다.
그러나 고성능 AI 칩 수요가 워낙 빠르게 증가하면서
**“CoWoS 캐파 병목”**은 여전히 해소되지 않고 있습니다.
| TSMC CoWoS | 1.4만 장 | 2.8만 장 | +100% | NVIDIA, AMD 전용 |
| 삼성 HPC | 0.8만 장 | 1.6만 장 | +100% | HBM3/3E 대응 |
| ASE / Amkor | 0.5만 장 | 1.0만 장 | +100% | 패키징 외주 전담 |
현재 CoWoS 생산 리드타임은 평균 16주로,
완성품 납기까지 5~6개월이 소요됩니다.
이 병목은 GPU·AI 칩 납기 지연의 주된 원인이기도 합니다.
4️⃣ Substrate(기판): 일본·대만 중심의 집중 구조
AI 칩용 고다층 기판(ABF Substrate)은
대부분 일본 Ibiden, 대만 Unimicron, 한국 대덕전자 등
소수 업체에 집중되어 있습니다.
- Ibiden: NVIDIA, TSMC 주요 공급
- Unimicron: AMD, Intel 납품
- 대덕전자: 삼성 HPC 패키지 납품
문제는 2026년 이후에도 신규 라인 증설이 제한적이라는 점입니다.
Substrate 병목은 공급망 전체의 생산 속도 한계선을 결정하게 됩니다.
5️⃣ HBM Vendor Share: 격차는 커지고 있습니다
| SK hynix | 51% | 54% | 56% | HBM3E 리더십, 안정적 TSV 효율 |
| 삼성전자 | 35% | 33% | 31% | 수율 안정화 지연 |
| Micron | 14% | 13% | 13% | 북미 AI 클라우드 중심 고객군 |
결국, HBM 시장의 중심은 수율이 아닌 공급 안정성으로 옮겨가고 있습니다.
TSV와 패키징의 캐파를 선제적으로 확보한 업체가
시장 점유율을 지속적으로 확대하는 구조입니다.
6️⃣ ORISEN 인사이트 — “기술보다 병목, 성능보다 안정성입니다.”
📍 TSV·패키징·Substrate는 HBM 시장의 공급 한계선을 결정합니다.
📍 AI 수요 폭발에도, 생산 캐파 확충은 2년 이상의 시차를 가집니다.
📍 Vendor 간 격차는 기술 경쟁보다 공급망 통제력에서 발생하고 있습니다.
결론:
HBM은 기술의 싸움이 아니라, 공급망의 싸움이 되고 있습니다.
산업은 이제 “더 빠른 칩”보다 “더 안정적인 공급”을 선택할 것입니다.
— ORISEN | Sector Analysis
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